逻辑异或运算是什么

1、异或（xor）是一个数学运算符。它应用于逻辑运算。

2、异或的数学符号为“⊕”，计算机符号为“xor”。其运算法则为：a⊕b = (¬a ∧ b) ∨ (a ∧¬b)

3、如果a、b两个值不相同，则异或结果为1。如果a、b两个值相同，异或结果为0。

4、逻辑异或运算简称异或。英文为exclusive OR，或缩写成xor。

5、异或也叫半加运算，其运算法则相当于不带进位的二进制加法：二进制下用1表示真，0表示假，则异或的运算法则为：0⊕0=0，1⊕0=1，0⊕1=1，1⊕1=0（同为0，异为1），这些法则与加法是相同的，只是不带进位，所以异或常被认作不进位加法。

一、运算法则

1、a ⊕ a = 0

2、a ⊕ b = b ⊕ a

3、a ⊕b ⊕ c = a ⊕ (b ⊕ c) = (a ⊕ b) ⊕ c;

4、d = a ⊕ b ⊕ c 可以推出 a = d ⊕ b ⊕ c

5、a ⊕ b ⊕ a = b

二、逻辑表达式：F=AB’⊕A’B（（AB’⊕A’B）’=AB⊙A’B’，⊙为“同或”运算）

参考资料：

1模N计数器的实现

一般设计中用到计数器时，我们可以调用lpm库中的计数器模块，也可以采用VHDL语言自己设计一个模N计数器。本设计采用VHDL语言设计一个最大模值为16的计数器。输入端口为：使能信号en，复位信号clr和时钟信号clk;输出端口为：qa、qb、qc、qd。其VHDL语言描述略。

2带使能控制的异或门的实现

输入端为：xor_en：异或使能，a和b：异或输入;输出端为：c：异或输出。当xor_en为高电平时，c输出a和b的异或值。当xor_en为低电平时，c输出信号b。其VHDL语言略。

32分频(触发器)的实现

输入端为：时钟信号clk，输入信号d;输出端为：q：输出信号a，q1：输出信号a反。其VHDL语言略。

4分频器的实现

本设计采用层次化的设计方法，首先设计实现分频器电路中各组成电路元件，然后通过元件例化的方法，调用各元件，实现整个分频器。其VHDL语言略。

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我想是异或。

设 A 密码必须有3个以上数字， A逆 密码可能有三个以下的数字；

B 密码必须有8个以上字符， B逆 密码可能有八个以下的字符。

1 A 异或 B 出现几种情况。 关键是判断 A真 B真时， A异或B的值是不是假。

A真 说明密码一定包含了 3 个以上数字，即密码不可能只包含三个以下数字；

B真 说明密码一定包含了 八个以上字符，即密码不可能只有八个以下的字符。

A,B同时为真，即 密码包含的数字个数不可能低于3，且密码包含的字符数不可能低于8。而这个命题是假的。

比如，21abcdefg，只有两个数字； 2133ab只有6个字符。但都是符合题目要求的密码。

2 假设是 A与B是或关系，当且仅当其两个变量的真值都为假时，其结果为假。 而 密码可能有三个以下数字且可能有八个以下字符的话，是真。故不为或关系。

为了方便说明，举例子解释。

模 运算

设有数a、b、c、d。如果a mod b=c，则有a=bk+c，其中k为整数，也就是说，可以把进行模运算的数看成是周期的，模运算就是把那些数的整的周期去掉，取余数。

模

>

举个例子来说 比如A和B 如果A对B对 A或B就是对的 A同或B是对的 A异或B就是错的 A对B错的情况 A或B对 A同或B错 A异或B对

A错B对的情况下跟A对B错是一样的

A错B错情况下 A或B错 A同或B对 A异或B错

或就是A和只要对一个以上就对 同或就是A的情况和B的情况是一样的话就对

异或就是A的情况和B的情况不一样的就对

understand 小同学

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